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FB18 Elektrotechnik und Informationstechnik · Angeboten in SoSe 2026
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Die Veranstaltung behandelt alle Synthese-Schritte von der Register-Transfer Ebene abwärts und konzentriert sich dabei auf FPGA-relevante Verfahren: Logikminimierungsverfahren (exakt und heuristisch, für zweistufige und Multi Level Logik) Technologiemapping mit funktionaler Dekomposition und strukturellen Ansätze (z.B. FlowMap) analytische und heuristische Placer (Simulated Annealing, Genetic Algorithms) typische Verdrahtungsalgorithmen (PathFinder)
Kein Prüfungstermin veröffentlicht.
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